職位描述
Verilog HDLVHDL
(1)掌握數(shù)字電路設(shè)計、FPGA設(shè)計開發(fā)等知識，熟悉Verilog、VHDL等程序設(shè)計語言。
(2)熟悉Quartus、ISE編譯環(huán)境的應(yīng)用，具有Altera、Xilinx等相關(guān)FPGA開發(fā)設(shè)計經(jīng)驗。
(3) 具備較強(qiáng)的英語讀寫能力，有比較強(qiáng)的邏輯分析能力，有非常好的團(tuán)隊協(xié)作精神。
工作地點
北京朝陽區(qū)中國電科第十一研究所
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