職位描述
VHDLVerilog HDLDSP開發(fā)網(wǎng)絡(luò)/信息安全計算機軟件通信/網(wǎng)絡(luò)設(shè)備
崗位職責(zé)：
1.完成FPGA開發(fā)的能力，包括方案設(shè)計、代碼實現(xiàn)及測試驗證；
2．能夠按照功能要求，在FPGA平臺上實現(xiàn)功能設(shè)計、仿真驗證，能夠配合軟硬件工程師完成整機產(chǎn)品及系統(tǒng)的聯(lián)調(diào)與測試；
3．負責(zé)FPGA產(chǎn)品相關(guān)開發(fā)及測試文檔的編寫
任職要求：
1．具有良好的數(shù)字電路基礎(chǔ)，熟練使用VHDL/Verilog等邏輯設(shè)計開發(fā)語言進行邏輯電路設(shè)計，掌握ISE或Vivado集成開發(fā)工具的使用
2．熟悉Xilinx/Altera的FPGA芯片架構(gòu)及通信、視頻和工控領(lǐng)域的應(yīng)用
3．有完整FPGA項目開發(fā)經(jīng)驗，并有相關(guān)的軟硬件并行加速系統(tǒng)設(shè)計經(jīng)驗
4.熟悉通信和信號處理基本流程和算法；
5.有基于FPGA深度學(xué)習(xí)開發(fā)經(jīng)驗的優(yōu)先。
1.完成FPGA開發(fā)的能力，包括方案設(shè)計、代碼實現(xiàn)及測試驗證；
2．能夠按照功能要求，在FPGA平臺上實現(xiàn)功能設(shè)計、仿真驗證，能夠配合軟硬件工程師完成整機產(chǎn)品及系統(tǒng)的聯(lián)調(diào)與測試；
3．負責(zé)FPGA產(chǎn)品相關(guān)開發(fā)及測試文檔的編寫
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1．具有良好的數(shù)字電路基礎(chǔ)，熟練使用VHDL/Verilog等邏輯設(shè)計開發(fā)語言進行邏輯電路設(shè)計，掌握ISE或Vivado集成開發(fā)工具的使用
2．熟悉Xilinx/Altera的FPGA芯片架構(gòu)及通信、視頻和工控領(lǐng)域的應(yīng)用
3．有完整FPGA項目開發(fā)經(jīng)驗，并有相關(guān)的軟硬件并行加速系統(tǒng)設(shè)計經(jīng)驗
4.熟悉通信和信號處理基本流程和算法；
5.有基于FPGA深度學(xué)習(xí)開發(fā)經(jīng)驗的優(yōu)先。
職位福利：五險一金、績效獎金、交通補助、餐補、通訊補助、帶薪年假、定期體檢
工作地點
中原區(qū)鄭州市高新區(qū)蓮花街55號
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職位發(fā)布者
徐聰慧/人事經(jīng)理
立即溝通
鄭州信大先進技術(shù)研究院鄭州信大先進技術(shù)研究院，是鄭州市人民政府、解放軍信息工程大學(xué)、鄭州高新技術(shù)產(chǎn)業(yè)開發(fā)區(qū)管理委員會三方共同建設(shè)和管理的新型研發(fā)機構(gòu)，是鄭州市注冊設(shè)立的事業(yè)法人單位，住所地為鄭州高新技術(shù)產(chǎn)業(yè)開發(fā)區(qū)，交通便利，環(huán)境優(yōu)美。研究院致力于新興產(chǎn)業(yè)技術(shù)研發(fā)、高新技術(shù)孵化、產(chǎn)品研制、市場開拓、教育培訓(xùn)、新產(chǎn)業(yè)戰(zhàn)略研究、科技服務(wù)等業(yè)務(wù)，常設(shè)教育培訓(xùn)中心、檢驗評測中心、產(chǎn)業(yè)發(fā)展咨詢中心等機構(gòu)。圍繞產(chǎn)品方向建有北斗導(dǎo)航定位創(chuàng)新中心、信息安全創(chuàng)新中心、智慧城市創(chuàng)新中心、網(wǎng)絡(luò)通信創(chuàng)新中心、數(shù)據(jù)工程創(chuàng)新中心、物聯(lián)網(wǎng)與云計算創(chuàng)新中心、測繪遙感創(chuàng)新中心等7個創(chuàng)新中心，深入開展基礎(chǔ)性、前瞻性、戰(zhàn)略性理論技術(shù)研究和應(yīng)用系統(tǒng)開發(fā)、產(chǎn)品研制等工作，打造科技自主創(chuàng)新高地和高端科技服務(wù)平臺，力爭成為鄭州乃至全省全國產(chǎn)業(yè)技術(shù)升級的“加速器”、軍事先進技術(shù)的“助推器”、信大綜合實力提升的“倍增器”。
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