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1. 主要負責FPGA開發(fā)，包括代碼編寫、仿真、時序約束、時序分析、調(diào)試和測試工作；
2. 編寫相關(guān)的設(shè)計文檔；
3. 熟練運用Verilog HDL語言，具有良好的編碼風格，會使用仿真工具對邏輯代碼進行仿真；
4. 熟悉VIVADO、ModelSim等邏輯開發(fā)工具，熟悉Xilinx的ZYNQ或7系列FPGA架構(gòu)和開發(fā)流程；
素質(zhì)要求：
1.優(yōu)秀的溝通能力、理解能力；
2.思維活躍，工作態(tài)度積極，積極地學習并掌握新技術(shù)；
3.有良好的溝通和學習能力、較強的團隊協(xié)作能力以及快速解決問題的能力；
4.可以承受工作壓力，有良好樂觀的心態(tài)；
5.具有責任意識、敬業(yè)誠信、對工作認真負責。