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更新于 6月18日

集成電路前端設計工程師

1.8-3.5萬·14薪
  • 無錫濱湖區(qū)
  • 5-10年
  • 碩士
  • 全職
  • 招3人

職位描述

數字前端設計數字前端驗證SoC設計FPGA芯片DSP芯片PCIE芯片ASIC芯片VCS電子/半導體/集成電路
崗位職責: 1. 負責芯片設計項目中數字前端設計開發(fā)工作,包括RTL設計、RTL驗證、形式驗證、RTL綜合、時序驗證、DFT/ATPG等工作,實現(xiàn)芯片功能、性能要求; 2. 對已有電路進行功能改進和功耗、面積和性能的優(yōu)化; 3. 參與Soc系統(tǒng)設計和IP設計; 4. 參與高速數字芯片平臺的系統(tǒng)研發(fā)工作; 5. 熟練使用數字IC設計的EDA工具,包括仿真、綜合、時序分析等; 6. 指導版圖設計并進行相關檢查和后仿真; 7. 指導設計測試方案,并協(xié)助對芯片樣片進行測試評估; 任職資格: 1. 本科及碩士研究生學歷,微電子、電子、通信、物理,數學等相關專業(yè); 2. 3-5年直接相關工作經驗,有帶小團隊經驗優(yōu)先; 3. 扎實的數字集成電路專業(yè)知識; 4. 熟練掌握Verilog語言,熟練使用相關EDA設計驗證工具; 5. 熟悉AMBA\AHB\AXI等常見片上總線的協(xié)議; 6. 操作相關測試儀器; 7. 有較強的邏輯思維能力、良好的溝通能力; 8. 踏實肯干,有責任心。
職位福利:五險一金、股票期權、餐補、員工旅游、帶薪年假

工作地點

濱湖區(qū)清華大學無錫應用技術研究院A3棟15樓1502室

職位發(fā)布者

魏哲文/招聘專員

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公司Logo無錫芯領域微電子有限公司
無錫芯領域微電子有限公司成立于2019年4月。公司核心團隊長期從事國產高性能處理器研究工作,對處理器微結構及其設計實現(xiàn)有深入研究,具備豐富的數字集成電路工程研發(fā)經驗。同時,公司具備從最底層的單元庫設計、Memory-Compiler設計、高速Serdes-IP設計以及處理器定制設計能力。團隊成員很多來自國內高等院校:北京大學、清華大學、交通大學、西北工業(yè)大學、湖南大學等。其母公司,上海耀芯電子科技有限公司成立于2014年5月,是一家SOC及ASIC設計服務公司,致力于為國內外集成電路廠商提供成套的解決方案。2019年成為國家認定的高新技術企業(yè)。主要業(yè)務方向:集成電路設計服務,具備高性能SoC、ASIC的前后端全流程設計能力。公司自成立以來發(fā)展迅速,為全國各地客戶承擔了多款高性能SoC以及ASIC芯片的設計業(yè)務,涉及領域包括:高性能可重構信號處理器設計,高速交換芯片,DSP處理器芯片設計。公司總部位于上海市浦東新區(qū)張江高科技園區(qū)畢升路299弄3號樓502室?,F(xiàn)由于上海及無錫子公司業(yè)務發(fā)展需要,誠邀微電子、半導體、計算機及電子類相關專業(yè)人才加盟。我們的事業(yè)前途極富競爭力,將為員工提供良好的工作環(huán)境、優(yōu)厚的福利待遇和廣闊的個人職業(yè)發(fā)展空間。歡迎愿與公司一同成長的你加入。
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