職位描述
Verilog HDLVHDL計(jì)算機(jī)硬件通信/網(wǎng)絡(luò)設(shè)備電子/半導(dǎo)體/集成電路
崗位職責(zé):
1、負(fù)責(zé)FPGA邏輯開發(fā)，尤其是算法到FPGA硬件的實(shí)現(xiàn)；
2、進(jìn)行FPGA編碼、調(diào)試；
3、負(fù)責(zé)FPGA設(shè)計(jì)文檔編寫；
4、配合軟、硬件設(shè)計(jì)人員完成相關(guān)任務(wù)目標(biāo)。
任職要求:
1、本科以上學(xué)歷，2年以上相關(guān)工作經(jīng)驗(yàn)，計(jì)算機(jī)、 自動(dòng)化、電子通信及相關(guān)專業(yè)；
2、熟悉掌握VHDL、Verilog語(yǔ)言；
3、了解FPGA開發(fā)方法，了解FPGA驗(yàn)證流程；
4、熟悉數(shù)字電路設(shè)計(jì)流程，有高速FPGA調(diào)試經(jīng)驗(yàn)及相關(guān)項(xiàng)目經(jīng)驗(yàn)者優(yōu)先；
5、具有良好的團(tuán)隊(duì)合作精神和溝通能力；
6、了解數(shù)字信號(hào)處理或參加過(guò)相關(guān)項(xiàng)目者優(yōu)先。
工作地點(diǎn)
蜀山區(qū)合肥國(guó)家實(shí)驗(yàn)室
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