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更新于 7月7日

FPGA工程師

1.5-2.5萬
  • 大連甘井子區(qū)
  • 5-10年
  • 碩士
  • 全職
  • 招1人

職位描述

Verilog HDLFPGA
崗位職責(zé): 1.參與產(chǎn)品整體系統(tǒng)架構(gòu)設(shè)計(jì),包括器件選型,器件間接口設(shè)計(jì),軟硬件功能劃分等; 2.負(fù)責(zé)項(xiàng)目和產(chǎn)品FPGA部分的算法研究,精通通信原理(如BPSK/QPSK/8PSK/16QAM調(diào)制解調(diào)、MIMO、信道編解碼、數(shù)字預(yù)失真),熟悉3GPP/IEEE等主流系統(tǒng)的通信協(xié)議; 3.熟練使用MATLAB進(jìn)行復(fù)雜通信算法的開發(fā); 4.使用Xilinx/Intel(Altera)FPGA開發(fā)工具(Vivado/Quartus),掌握Verilog/VHDL; 5.具備通信系統(tǒng)級(jí)設(shè)計(jì)能力(如基帶處理、射頻前端協(xié)同設(shè)計(jì)),有大規(guī)模FPGA項(xiàng)目量產(chǎn)經(jīng)驗(yàn)者優(yōu)先。 任職要求: 1.研究生及以上學(xué)歷,通信、電子及相關(guān)專業(yè)(必須條件),8年以上相關(guān)工作經(jīng)驗(yàn); 2.熟悉通信系統(tǒng)的組成和構(gòu)架,精通數(shù)字信號(hào)處理方法,如調(diào)制解調(diào)、編譯碼、數(shù)字預(yù)失真等。

工作地點(diǎn)

大連甘井子區(qū)航天大廈

職位發(fā)布者

梁英/人力資源

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遨??萍加邢薰居芍袊?guó)運(yùn)載火箭技術(shù)研究院+大連海事大學(xué)+大連遨海科技發(fā)展中心聯(lián)合組建,完全自主研發(fā)+高科技央企,總部位于大連高新園區(qū)航天大廈(北京有分公司),擁有一支長(zhǎng)期從事通信、導(dǎo)航及信息系統(tǒng)設(shè)計(jì)、開發(fā)、集成的優(yōu)秀團(tuán)隊(duì)。我們每年代表中國(guó)參加國(guó)際海事會(huì)議,自主研發(fā)產(chǎn)品在世界范圍內(nèi)率先實(shí)現(xiàn)海上3G通信,為員工繳納商業(yè)保險(xiǎn),社保公積金(各12%)均以全額工資為基數(shù)、更有午睡休憩室、活動(dòng)室,加入央企,職等您來!
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